[发明专利]通过双SSTL电路产生C_PHY信号的装置有效
| 申请号： | 201810439627.5 | 申请日： | 2018-05-09 |
| 公开（公告）号： | CN108595361B | 公开（公告）日： | 2020-09-18 |
| 发明（设计）人： | 余广得 | 申请（专利权）人： | 武汉精测电子集团股份有限公司 |
| 主分类号： | G06F13/40 | 分类号： | G06F13/40 |
| 代理公司： | 武汉开元知识产权代理有限公司 42104 | 代理人： | 黄行军 |
| 地址： | 430070 湖北省武汉*** | 国省代码： | 湖北;42 |
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| 摘要： | 本发明涉及C_PHY信号技术领域，具体涉及一种通过双SSTL电路产生C_PHY信号的装置。包括集成于FPGA内部的第一SSTL电路、第二SSTL电路和第三SSTL电路，FPGA具有第一引脚、第二引脚和第三引脚，第一引脚和第二引脚后连接有差分运放电路和放大倍数设置及反馈电路，第三引脚后串联有第二运放电路，第一SSTL电路和第二SSTL电路并联，第一SSTL电路、第二SSTL电路、放大倍数设置及反馈电路、差分运放电路共同组成C_PHY信号的HS信号输出端，第三SSTL电路和第二运放电路共同组成C_PHY信号的LP信号输出端。不依赖于第三方C_PHY芯片，基于FPGA实现C_PHY信号输出，出相同的C_PHY信号，其采用的IO管脚大大减少，并节省了成本，组合灵活，可以根据需求选择信号lane数。 | ||
| 搜索关键词： | 通过 sstl 电路 产生 c_phy 信号 装置 | ||
【主权项】：
1.一种通过双SSTL电路产生C_PHY信号的装置，其特征在于：包括集成于FPGA内部的第一SSTL电路、第二SSTL电路和第三SSTL电路，所述FPGA具有分别供第一SSTL电路、第二SSTL电路、第三SSTL电路输出的第一引脚(7)、第二引脚(8)和第三引脚(9)，所述第一引脚(7)和第二引脚(8)后连接有差分运放电路和用于设置差分运放电路放大倍数的放大倍数设置及反馈电路，所述第三引脚(9)后串联有第二运放电路，所述第一SSTL电路和第二SSTL电路并联，所述第一SSTL电路、第二SSTL电路、放大倍数设置及反馈电路、差分运放电路共同组成C_PHY信号的HS信号输出端，所述第三SSTL电路和第二运放电路共同组成C_PHY信号的LP信号输出端。
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