[发明专利]针对海量存储装置来检测静默数据讹误在审
| 申请号： | 201811044115.5 | 申请日： | 2018-09-07 |
| 公开（公告）号： | CN109471751A | 公开（公告）日： | 2019-03-15 |
| 发明（设计）人： | T.阮;S.K.K.科卡 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F11/10 | 分类号： | G06F11/10 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 姜冰;张金金 |
| 地址： | 美国加利*** | 国省代码： | 美国;US |
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| 摘要： | 一个实施例提供存储控制器。存储控制器包括：主机数据分段逻辑，所述主机数据分段逻辑用于响应于来自主机域的、用于将数据有效负载写入到存储装置的写入命令，将数据有效负载划分成多个数据段；循环冗余校验（CRC）编码逻辑，所述循环冗余校验（CRC）编码逻辑用于生成每个数据段的CRC码；以及CRC重排序编码逻辑，所述CRC重排序编码逻辑用于将每个CRC码指派到多个数据段之中的另一数据段。 | ||
| 搜索关键词： | 编码逻辑 数据段 数据有效负载 循环冗余校验 存储控制器 主机数据 重排序 分段 海量存储装置 存储装置 数据讹误 写入命令 静默 主机 写入 指派 响应 检测 | ||
【主权项】：
1.一种存储控制器，包括：主机数据分段逻辑，所述主机数据分段逻辑用于响应于来自主机域的、用于将数据有效负载写入到存储装置的写入命令，将所述数据有效负载划分成多个数据段；循环冗余校验（CRC）编码逻辑，所述循环冗余校验（CRC）编码逻辑用于生成每个数据段的CRC码；以及CRC重排序编码逻辑，所述CRC重排序编码逻辑用于将每个CRC码指派到所述多个数据段之中的另一数据段。
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