[实用新型]行波进位加法器及应用其的数据运算单元、芯片、算力板和计算设备有效
| 申请号： | 201820987781.1 | 申请日： | 2018-06-25 |
| 公开（公告）号： | CN208607648U | 公开（公告）日： | 2019-03-15 |
| 发明（设计）人： | 刘杰尧;张楠赓;吴敬杰;马晟厚 | 申请（专利权）人： | 北京嘉楠捷思信息技术有限公司 |
| 主分类号： | G06F7/502 | 分类号： | G06F7/502 |
| 代理公司： | 北京律诚同业知识产权代理有限公司 11006 | 代理人： | 梁挥;祁建国 |
| 地址： | 100094 北京市海淀区*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型提供一种行波进位加法器及应用其的数据运算单元、芯片、算力板和计算设备。行波进位加法器包括多个输入端，用于提供运算数据和进位输入；多个输出端，用于将运算结果输出并提供进位输出；至少一组级联的全加器，连接在所述输入端和所述输出端之间，用于对所述输入端的所述运算数据和所述进位输入进行运算；其中，所述级联的全加器之间为互补结构。本实用新型的行波进位加法器，能够有效减小加法器链的计算延迟。 | ||
| 搜索关键词： | 行波进位加法器 进位 数据运算单元 本实用新型 计算设备 运算数据 全加器 输出端 输入端 级联 力板 芯片 互补结构 运算结果 输出 加法器 减小 延迟 运算 应用 | ||
【主权项】：
1.一种行波进位加法器，其特征在于，包括：多个输入端，用于提供运算数据和进位输入；多个输出端，用于将运算结果输出并提供进位输出；至少一组级联的全加器，连接在所述输入端和所述输出端之间，用于对所述输入端的所述运算数据和所述进位输入进行运算；其中，所述级联的全加器之间为互补结构。
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