[实用新型]一种超低电压异或门电路有效
| 申请号： | 201821307048.7 | 申请日： | 2018-08-14 |
| 公开（公告）号： | CN208754266U | 公开（公告）日： | 2019-04-16 |
| 发明（设计）人： | 史伟伟 | 申请（专利权）人： | 深圳大学 |
| 主分类号： | H03K19/21 | 分类号： | H03K19/21 |
| 代理公司： | 深圳市瑞方达知识产权事务所(普通合伙) 44314 | 代理人： | 林俭良;冯小梅 |
| 地址： | 518060 广东*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型涉及一种超低电压异或门电路，包括第一驱动电路、与第一驱动电路对应设置的第二驱动电路、驱动晶体管、以及调节电路；第一驱动电路的控制端连接输入信号，第一驱动电路的第一端连接驱动晶体管的第一电极和电源VDD，第二端连接驱动晶体管的第二电极；驱动晶体管的第二电极还连接调节电路的第一端，驱动晶体管的第三电极连接超低电压异或门电路的输出端，驱动晶体管的第三电极还连接第二驱动电路的第一端，第二驱动电路的第二端接地，驱动电路的控制端连接输入信号；调节电路的控制端连接电源VDD，调节电路的第二端接地。本实用新型可以增强输出端输出零低电平时的下拉能力，电路逻辑延时相比传统电路速度更快。 | ||
| 搜索关键词： | 驱动晶体管 第一驱动电路 第二驱动电路 异或门电路 超低电压 电路 第一端 控制端 本实用新型 第二电极 第三电极 端接地 输出端 传统电路 第一电极 电路逻辑 连接电源 驱动电路 低电 下拉 延时 电源 输出 | ||
【主权项】：
1.一种超低电压异或门电路，其特征在于，包括第一驱动电路、与所述第一驱动电路对应设置的第二驱动电路、驱动晶体管、以及调节电路；所述第一驱动电路的控制端连接输入信号，所述第一驱动电路的第一端连接所述驱动晶体管的第一电极和电源VDD，所述第一驱动电路的第二端连接所述驱动晶体管的第二电极；所述驱动晶体管的第二电极还连接所述调节电路的第一端，所述驱动晶体管的第三电极连接所述超低电压异或门电路的输出端，所述驱动晶体管的第三电极还连接所述第二驱动电路的第一端，所述第二驱动电路的第二端接地，所述驱动电路的控制端连接所述输入信号；所述调节电路的控制端连接电源VDD，所述调节电路的第二端接地；所述第一驱动电路和所述第二驱动电路根据所述输入信号导通或截止，所述调节电路根据所述电源VDD导通或截止；所述输出端在所述第一驱动电路、所述第二驱动电路、所述调节电路导通时，输出逻辑零低电平；所述输出在所述第一驱动电路和所述第二驱动电路截止、所述调节电路导通时，输出逻辑高电平。
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