[实用新型]大数据运算芯片有效
| 申请号： | 201821766507.8 | 申请日： | 2018-10-30 |
| 公开（公告）号： | CN209560543U | 公开（公告）日： | 2019-10-29 |
| 发明（设计）人： | 秦强 | 申请（专利权）人： | 北京比特大陆科技有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78 |
| 代理公司： | 北京同立钧成知识产权代理有限公司 11205 | 代理人： | 张子青;刘芳 |
| 地址： | 100192 北京市*** | 国省代码： | 北京;11 |
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| 摘要： | 本实用新型实施例提供一种大数据运算芯片，所述运算芯片包括N个内核core、N个数据通道和至少一个存储单元，N为大于或者等于4的整数；所述数据通道包括发送接口和接收接口，所述内核core和数据通道一一对应，所述内核core通过数据通道发送和接收数据；所述运算芯片通过所述发送接口和所述接收接口和芯片外部进行数据传输；N个内核core中的每个内核都连接到所述至少一个存储单元。多个ASIC芯片共享存储单元，这样不仅减少了存储单元的数量，也减少了ASIC运算芯片之间的连接线，简化了系统构造，减低了ASIC芯片的成本。 | ||
| 搜索关键词： | 运算芯片 内核 数据通道 存储单元 发送接口 接收接口 大数据 共享存储单元 连接线 本实用新型 接收数据 数据传输 系统构造 发送 芯片 外部 | ||
【主权项】：
1.一种大数据运算芯片，其特征在于，所述运算芯片包括N个内核core、N个数据通道lane和至少一个存储单元，其中，N为大于或者等于4的整数；所述数据通道lane包括发送接口(tx)和接收接口(rx)，所述内核core和数据通道lane一一对应，所述内核core通过数据通道lane发送和接收数据；所述运算芯片通过所述发送接口(tx)和所述接收接口(rx)和芯片外部进行数据传输；N个内核core中的每个所述内核core都连接到所述至少一个存储单元。
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