[发明专利]用于在存储器装置中提供不同时钟频率的内部时钟信号的设备和方法有效
| 申请号： | 201880007233.0 | 申请日： | 2018-01-10 |
| 公开（公告）号： | CN110199353B | 公开（公告）日： | 2023-08-25 |
| 发明（设计）人： | J·波尔纳 | 申请（专利权）人： | 美光科技公司 |
| 主分类号： | G11C7/22 | 分类号： | G11C7/22;G11C7/10;G11C8/18 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 王龙 |
| 地址： | 美国爱*** | 国省代码： | 暂无信息 |
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| 摘要： | 在本申请案中描述用于在半导体装置中提供不同时钟频率的内部时钟信号的设备和方法。实例设备包含读取命令缓冲器和读取数据输出电路。所述读取命令缓冲器响应于第一时钟信号而缓冲读取命令并且响应于第二时钟信号而提供所述读取命令。所述读取数据输出电路当被来自所述读取命令缓冲器的所述读取命令启动时并行接收多个数据位，并且响应于输入/输出IO时钟信号而依序提供所述多个数据位。数据时钟定时电路提供在第一模式中具有第一时钟频率并且在第二模式中具有第二时钟频率的所述IO时钟信号，并且另外提供在所述第一和第二模式中具有所述第一时钟频率的所述第二时钟信号。 | ||
| 搜索关键词： | 用于 存储器 装置 提供 不同 时钟 频率 内部 信号 设备 方法 | ||
【主权项】：
1.一种设备，其包括：读取命令缓冲器，其被配置成响应于第一时钟信号而缓冲读取命令并且被配置成响应于第二时钟信号而提供缓冲的读取命令；读取数据输出电路，其被配置成当被所述缓冲的读取命令启动时并行接收多个数据位，并且响应于输入/输出IO时钟信号而依序提供所述多个数据位；和数据时钟定时电路，其被配置成提供在第一模式中具有第一时钟频率的所述IO时钟信号并且提供在第二模式中具有第二时钟频率的所述IO时钟信号，且还被配置成提供在所述第一和第二模式中具有所述第一时钟频率的所述第二时钟信号。
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