[发明专利]FPGA加速卡传输性能测试方法、装置及设备和介质有效
| 申请号： | 201910016326.6 | 申请日： | 2019-01-08 |
| 公开（公告）号： | CN109739712B | 公开（公告）日： | 2022-02-18 |
| 发明（设计）人： | 王彦伟;郝锐;张闯 | 申请（专利权）人： | 郑州云海信息技术有限公司 |
| 主分类号： | G06F11/22 | 分类号： | G06F11/22;G06F11/26 |
| 代理公司： | 北京集佳知识产权代理有限公司 11227 | 代理人： | 罗满 |
| 地址： | 450018 河南省郑州市*** | 国省代码： | 河南;41 |
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| 摘要： | 本申请公开了一种FPGA加速卡传输性能测试方法、装置及电子设备和计算机可读存储介质，该方法包括：获取传输完成的第一数据包和第二数据包；确定第一数据包的第一周期计数、第一帧计数和第二数据包的第二周期计数、第二帧计数；周期计数为数据包发送时FPGA的时钟周期计数，帧计数为标识数据包发送序列的计数；利用第一周期计数、第一帧计数、第二周期计数、第二帧计数，以及单位数据大小、时钟周期，确定单位时间内的单位数据传输量，得到第一传输性能指标。本申请利用传输完成的数据包对应的周期计数以及帧计数，确定单位时间内单位数据传输量，得到用于表征FPGA加速卡传输性能的第一传输性能指标，实现了对加速卡传输性能的测试。 | ||
| 搜索关键词： | fpga 加速卡 传输 性能 测试 方法 装置 设备 介质 | ||
【主权项】：
1.一种FPGA加速卡传输性能测试方法，其特征在于，包括：获取传输完成后的第一数据包和第二数据包；确定所述第一数据包的第一周期计数、第一帧计数和所述第二数据包的第二周期计数、第二帧计数；其中，所述周期计数为数据包发送时对应的FPGA的时钟周期计数，所述帧计数为标识当前数据包发送序列的计数；利用所述第一周期计数、所述第一帧计数、所述第二周期计数、所述第二帧计数，以及每帧的单位数据大小、FPGA的时钟周期，确定单位时间内的单位数据传输量，得到第一传输性能指标。
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