[发明专利]可缩放GPU中的数据分布组构有效
| 申请号： | 201910463455.X | 申请日： | 2015-05-13 |
| 公开（公告）号： | CN110415158B | 公开（公告）日： | 2023-05-30 |
| 发明（设计）人： | A.科克;L.斯特里拉马萨马;A.阿利 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06T1/20 | 分类号： | G06T1/20 |
| 代理公司： | 中国专利代理(香港)有限公司 72001 | 代理人： | 李伟森;杨美灵 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
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| 摘要： | 在一个实施例中，混合组构互连处理器内的多个图形处理器核。混合组构互连包含多个数据通道，其包含可编程虚拟数据通道。虚拟数据通道携带基于分组的消息的多个业务类别。虚拟数据通道和多个业务类别可被指配多个优先级中的一个优先级。虚拟数据通道可以独立仲裁。混合组构是可缩放的，并且能支持多个拓扑，包含多个堆叠式集成电路拓扑。 | ||
| 搜索关键词： | 缩放 gpu 中的 数据 分布 组构 | ||
【主权项】：
1.一种异构三维电路堆栈，包括：第一处理器；第二处理器，通过一个或多个硅通孔通路与所述第一处理器通信耦合，其中所述第一处理器或所述第二处理器中的至少一个是图形处理器；以及互连逻辑，用来将所述第一处理器和所述第二处理器通信地耦合到共享资源，所述互连逻辑用来通过相应的片上互连与所述第一处理器和所述第二处理器耦合；其中，所述互连逻辑包括带宽共享逻辑以用来调整到所述共享资源的带宽；以及其中所述共享资源包括用来高速缓存经由所述互连逻辑接收的数据的存储器。
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