[发明专利]3D存储器件及其制造方法有效
申请号: | 201910552416.7 | 申请日: | 2019-06-19 |
公开(公告)号: | CN110233153B | 公开(公告)日: | 2021-05-11 |
发明(设计)人: | 汤召辉;张磊;李思晢;周玉婷;董明;曾凡清 | 申请(专利权)人: | 长江存储科技有限责任公司 |
主分类号: | H01L27/1157 | 分类号: | H01L27/1157;H01L27/11582 |
代理公司: | 北京成创同维知识产权代理有限公司 11449 | 代理人: | 蔡纯;高青 |
地址: | 430074 湖北省武汉市洪山区东*** | 国省代码: | 湖北;42 |
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摘要: | 本申请公开了一种3D存储器件及其制造方法。该制造方法包括:在叠层结构上形成第一缓冲层;在第一缓冲层上形成至少一组牺牲叠层,每组牺牲叠层包括第一掩模层和位于第一掩模层上的第二缓冲层;在牺牲叠层上形成第二掩模层;形成覆盖第二掩模层与切割区的填充层;对填充层进行退火处理;研磨填充层,并停止于第二掩模层;去除第二掩模层以暴露牺牲叠层;同时研磨第二缓冲层和部分填充层,并停止于第一掩膜层;去除第一掩膜层;以及研磨填充层,并停止于第一缓冲层。通过该制造方法不但修复了因退火步骤导致的器件区与切割区的高度差,而且修复了由于填充层沉积不均匀的而导致的高度差,使得3D存储器件的表面更加平坦。 | ||
搜索关键词: | 存储 器件 及其 制造 方法 | ||
【主权项】:
1.一种3D存储器件的制造方法,其特征在于,包括:在半导体衬底上形成叠层结构,所述半导体衬底包括器件区与切割区,所述叠层结构位于所述器件区,所述切割区位于所述器件区的一侧;在所述叠层结构上形成第一缓冲层;在所述第一缓冲层上形成至少一组牺牲叠层,每组所述牺牲叠层包括第一掩模层和位于所述第一掩模层上的第二缓冲层;在所述牺牲叠层上形成第二掩模层;形成覆盖所述第二掩模层与所述切割区的填充层;对所述填充层进行退火处理;研磨所述填充层,并停止于所述第二掩模层;去除所述第二掩模层以暴露所述牺牲叠层;通过去除每组所述牺牲叠层,对所述填充层进行初步平坦化;以及研磨所述填充层,并停止于所述第一缓冲层,其中,去除每组所述牺牲叠层的步骤包括:同时研磨所述第二缓冲层和部分所述填充层,并停止于所述第一掩膜层;以及去除所述第一掩膜层。
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H01 基本电气元件
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
H01L27-01 .只包括有在一公共绝缘衬底上形成的无源薄膜或厚膜元件的器件
H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
H01L27-15 .包括专门适用于光发射并且包括至少有一个电位跃变势垒或者表面势垒的半导体组件
H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的
H01L 半导体器件;其他类目中不包括的电固体器件
H01L27-00 由在一个共用衬底内或其上形成的多个半导体或其他固态组件组成的器件
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H01L27-02 .包括有专门适用于整流、振荡、放大或切换的半导体组件并且至少有一个电位跃变势垒或者表面势垒的;包括至少有一个跃变势垒或者表面势垒的无源集成电路单元的
H01L27-14 . 包括有对红外辐射、光、较短波长的电磁辐射或者微粒子辐射并且专门适用于把这样的辐射能转换为电能的,或适用于通过这样的辐射控制电能的半导体组件的
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H01L27-16 .包括含有或不含有不同材料结点的热电元件的;包括有热磁组件的