[发明专利]一种FPGA和MIPI电路中的时钟恢复电路在审
| 申请号： | 201910650678.7 | 申请日： | 2019-07-18 |
| 公开（公告）号： | CN110611505A | 公开（公告）日： | 2019-12-24 |
| 发明（设计）人： | 刘健;王海力;陈子贤;马明 | 申请（专利权）人： | 京微齐力(北京)科技有限公司 |
| 主分类号： | H03L7/08 | 分类号： | H03L7/08;H03L7/085;H03L7/16;H03K5/133;H03K5/135 |
| 代理公司： | 11309 北京亿腾知识产权代理事务所(普通合伙) | 代理人： | 陈霁 |
| 地址： | 100190 北京市海淀区*** | 国省代码： | 北京;11 |
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| 摘要： | 本发明公开了一种FPGA和MIPI电路中的时钟恢复电路，包括：FPGA、移动产业处理器接口MIPI和延迟锁相环DLL；其中，FPGA和MIPI之间进行数据信号传输；MIPI在第一时钟下工作；并将第一时钟发送给DLL；第一时钟经历传输过程中的第一延迟，形成第二时钟接入DLL；DLL对第二时钟进行延迟和锁相处理，得到第三时钟，并将第三时钟发送到FPGA；第三时钟经历传输过程中的第二延迟，形成第四时钟接入FPGA；FPGA在第四时钟下工作。采用DLL恢复出和第一时钟同相位的本地时钟，即第四时钟。使来自MIPI的远程数据在FPGA内部使用与MIPI中相同的时钟信号进行处理。 | ||
| 搜索关键词： | 延迟 传输过程 时钟恢复电路 数据信号传输 处理器接口 延迟锁相环 时钟信号 远程数据 同相位 电路 移动 恢复 | ||
【主权项】：
1.一种FPGA和MIPI电路中的时钟恢复电路，其特征在于，包括：FPGA、移动产业处理器接口MIPI和延迟锁相环DLL；其中，/nFPGA和MIPI之间进行数据信号传输；/nMIPI在第一时钟下工作；并将所述第一时钟发送给DLL；所述第一时钟经历传输过程中的第一延迟，形成第二时钟接入DLL；/nDLL对第二时钟进行延迟和锁相处理，得到第三时钟，并将所述第三时钟发送到FPGA；所述第三时钟经历传输过程中的第二延迟，形成第四时钟接入FPGA；/nFPGA在所述第四时钟下工作；/n其中，DLL根据预先测得的第一延迟和第二延迟，对第二时钟进行相位调整，使第四时钟与第一时钟相位相同。/n
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