[发明专利]一种FPGA芯片及其配置方法有效
| 申请号： | 201911003376.7 | 申请日： | 2019-10-22 |
| 公开（公告）号： | CN110515891B | 公开（公告）日： | 2020-02-14 |
| 发明（设计）人： | 周垣;林晓志;王仙芳;胡涛 | 申请（专利权）人： | 广东高云半导体科技股份有限公司 |
| 主分类号： | G06F15/78 | 分类号： | G06F15/78;G06F15/177 |
| 代理公司： | 44325 深圳众鼎专利商标代理事务所(普通合伙) | 代理人： | 黄章辉 |
| 地址： | 510000 广东省广*** | 国省代码： | 广东;44 |
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| 摘要： | 本发明公开了一种FPGA芯片及其配置方法，所述FPGA芯片的配置方法包括：在FPGA芯片上电时，接收用户配置信息，并将所述用户配置信息转换成初始化配置信息；根据所述初始化配置信息进行数据总线编址，生成第一IP核配置信息；在检测到所述IP核的目标IP核地址与所述第一IP核配置信息中的第一IP核地址匹配时，读取与所述第一IP核地址匹配的所述第一IP核配置信息中的所述第一IP核数据，并将读取的所述第一IP核数据写入与所述目标IP核地址对应IP核的寄存器中。本发明实现了FPGA芯片配置的灵活性和可控制性，并降低了成本。 | ||
| 搜索关键词： | 读取 初始化配置 地址匹配 目标IP 用户配置信息 地址对应 接收用户 可控制性 配置信息 数据总线 寄存器 配置的 编址 配置 上电 写入 转换 检测 | ||
【主权项】：
1.一种FPGA芯片的配置方法，其特征在于，所述FPGA芯片包括初始化配置转换模块、通用并行总线路由模块和至少一个可编程逻辑模块，一个所述可编程逻辑模块中包含一个IP核，所述方法包括：/n在FPGA芯片上电时，所述初始化配置转换模块接收用户配置信息，初始化配置转换模块并将所述用户配置信息转换成初始化配置信息；/n所述通用并行总线路由模块根据所述初始化配置信息进行数据总线编址，所述通用并行总线路由模块生成第一IP核配置信息；所述第一IP核配置信息包括至少一个第一IP核数据以及与各所述第一IP核数据关联的第一IP核地址；所述总线编址，是使用统一地址编址方式和总线格式对数据进行处理；/n所述可编程逻辑模块在检测到所述IP核的目标IP核地址与所述第一IP核配置信息中的第一IP核地址匹配时，所述可编程逻辑模块读取与所述第一IP核地址匹配的所述第一IP核配置信息中的所述第一IP核数据，所述可编程逻辑模块并将读取的所述第一IP核数据写入与所述目标IP核地址对应IP核的寄存器中。/n
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