[发明专利]用于FPGA芯片的高速串并转换接口字同步方法和电路在审
| 申请号： | 201911398757.X | 申请日： | 2019-12-30 |
| 公开（公告）号： | CN111130560A | 公开（公告）日： | 2020-05-08 |
| 发明（设计）人： | 王兴兴;冯晓玲;张亭亭;贾红;陈维新;韦嶔;程显志 | 申请（专利权）人： | 西安智多晶微电子有限公司 |
| 主分类号： | H03M9/00 | 分类号： | H03M9/00 |
| 代理公司： | 西安嘉思特知识产权代理事务所(普通合伙) 61230 | 代理人： | 闫家伟 |
| 地址： | 710075 陕西省西安*** | 国省代码： | 陕西;61 |
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| 摘要： | 本发明公开了一种用于FPGA芯片的高速串并转换接口字同步方法和电路，所述方法包括：利用串并转换模块将接收的串行数据信号转换为并行数据信号；比较所述并行数据信号与预先设置的字同步字符，获得字同步控制信号；根据所述字同步控制信号在串并转换过程中重复进行字同步操作，直到所述并行数据信号与预先设置的字同步字符一致；获得所述串行数据信号的正确边界，并将完成字同步的并行数据信号输出。本发明的方法和电路能够在串并转换过程中对输出的并行数据进行校验和调整，将完成字同步后的并行数据输出下一级电路，避免输出错误的数据。 | ||
| 搜索关键词： | 用于 fpga 芯片 高速 转换 接口 同步 方法 电路 | ||
【主权项】：
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