[实用新型]一种DRAM全局字线驱动电路有效
| 申请号： | 201920881743.2 | 申请日： | 2019-06-13 |
| 公开（公告）号： | CN209747134U | 公开（公告）日： | 2019-12-06 |
| 发明（设计）人： | 杜艳强;吴君;张学渊;朱光伟 | 申请（专利权）人： | 苏州汇峰微电子有限公司 |
| 主分类号： | G11C11/408 | 分类号： | G11C11/408 |
| 代理公司： | 32234 苏州广正知识产权代理有限公司 | 代理人： | 谢东<国际申请>=<国际公布>=<进入国 |
| 地址： | 215000 江苏省苏州市苏州工业园*** | 国省代码： | 江苏;32 |
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| 摘要： | 本实用新型公开了一种DRAM全局字线驱动电路，包括全局字线驱动模块和电源切换模块，所述的电源切换模块的输出与多个所述的全局字线驱动模块的电源输入相连，其中，所述的全局字线驱动模块包括依次连接用于驱动全局字线的地址选择下拉电路、预充电锁存电路和全局字线输出驱动电路。通过上述方式，本实用新型提供的DRAM全局字线驱动电路，结构简单，设计合理，能够有效地降低DRAM全局字线驱动电路在待机模式下的漏电，通过降低待机模式下的全局字线驱动电路的电源电压，来减小其晶体管源漏两端跨压，增大PMOS晶体管的阈值电压的绝对值，从而达到减小其漏电电流的目的。 | ||
| 搜索关键词： | 全局字线 驱动电路 驱动模块 电源切换模块 本实用新型 减小 输出驱动电路 在待机模式 待机模式 地址选择 电源电压 电源输入 晶体管源 漏电电流 锁存电路 下拉电路 依次连接 阈值电压 漏电 有效地 预充电 跨压 驱动 输出 | ||
【主权项】：
1.一种DRAM全局字线驱动电路，其特征在于，包括全局字线驱动模块和电源切换模块，所述的电源切换模块的输出与多个所述的全局字线驱动模块的电源输入相连，其中，所述的全局字线驱动模块包括依次连接用于驱动全局字线的地址选择下拉电路、预充电锁存电路和全局字线输出驱动电路。/n
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