[发明专利]基于占空比校正系统和低压差（LDO）调节器的延迟锁相环（DLL）在审
| 申请号： | 201980043304.7 | 申请日： | 2019-06-25 |
| 公开（公告）号： | CN112740552A | 公开（公告）日： | 2021-04-30 |
| 发明（设计）人： | 亚伦·马丁;罗杰·程;哈里·文卡特拉玛尼;纳夫尼特·杜尔;莫日干·曼苏里;布赖恩·卡斯珀;弗兰克·奥`马奥尼;格涅什·巴拉穆鲁干;阿杰·巴兰库蒂;周宽;斯里达尔·提鲁马莱;克里希那穆尔西·文卡塔拉马纳;亚历克斯·托马斯;夸克·阮 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | H03K5/156 | 分类号： | H03K5/156;G05F1/575;H03L7/081;G06F1/08 |
| 代理公司： | 北京东方亿思知识产权代理有限责任公司 11258 | 代理人： | 张敏 |
| 地址： | 美国加利*** | 国省代码： | 暂无信息 |
| 权利要求书： | 查看更多 | 说明书： | 查看更多 |
| 摘要： | 提供了一种装置，其中该装置包括多个组件；第一电路，该第一电路用于生成时钟信号并将时钟信号提供给多个组件；第二电路，该第二电路用于为多个组件中的两个或更多个组件中的每个组件估计在相应组件处接收到的时钟信号的相应占空比，其中与两个或更多个组件相对应的两个或更多个占空比被确定；第三电路，该第三电路用于确定两个或更多个占空比的平均值；以及第四电路，该第四电路用于至少部分地基于平均值校正由第一电路生成的时钟信号的占空比。 | ||
| 搜索关键词： | 基于 校正 系统 低压 ldo 调节器 延迟 锁相环 dll | ||
【主权项】：
暂无信息
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