[发明专利]一种优化时分复用技术的多阶段FPGA布线方法有效

专利信息
申请号: 202010126180.3 申请日: 2020-02-28
公开(公告)号: CN111310409B 公开(公告)日: 2022-04-08
发明(设计)人: 郭文忠;庄震;刘耿耿;黄兴;陈国龙 申请(专利权)人: 福州大学
主分类号: G06F30/392 分类号: G06F30/392;G06F30/331;G06N20/00
代理公司: 福州元创专利商标代理有限公司 35100 代理人: 陈明鑫;蔡学俊
地址: 350108 福建省福州市*** 国省代码: 福建;35
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摘要: 发明涉及一种优化时分复用技术的多阶段FPGA布线方法,包括以下步骤:步骤S1:采集FPGA集合、FPGA连接对集合、线网集合和线网组集合;步骤S2:根据FPGA集合、FPGA连接对集合、线网集合和线网组集合,在未分配TR的情况下获取线网的布线拓扑;步骤S3:根据每个线网组的时延情况的不同,为每个线网的每条边分配对应的TR;步骤S4:循环进行TR缩减和边合法化,迭代优化TR值大于预设值的线网组,直到满足迭代终止的条件时,得到最优布线方案。本发明可以优化多FPGA原型系统的片间信号延迟和可布线性问题。
搜索关键词: 一种 优化 时分 技术 阶段 fpga 布线 方法
【主权项】:
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