[发明专利]一种集成电路分层走线规划方法、装置、存储介质及设备在审
| 申请号： | 202011352799.2 | 申请日： | 2020-11-27 |
| 公开（公告）号： | CN112347732A | 公开（公告）日： | 2021-02-09 |
| 发明（设计）人： | 葛颖峰;朱勇;徐祎喆 | 申请（专利权）人： | 北京百瑞互联技术有限公司 |
| 主分类号： | G06F30/392 | 分类号： | G06F30/392;G06F30/394;G06F30/398 |
| 代理公司： | 北京国科程知识产权代理事务所(普通合伙) 11862 | 代理人： | 曹晓斐 |
| 地址： | 100085 北京市海淀区上地信息路2号(北京实创*** | 国省代码： | 北京;11 |
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| 摘要： | 本申请公开了一种集成电路分层走线规划方法、装置、存储介质及设备，属于集成电路设计领域。该方法主要包括将根据对芯片设计布局的分析结果获取的限定区域进行切分，获得多个形状规则的多边形子区域；分别获取多个多边形子区域与其他多边形子区域之间的连线的走线信息以及确定多个多边形子区域与其他多边形子区域之间的连线的走线层数。本申请采用区域化分析方法可以在设计早期评估绕线密度问题，并且能够及时给出定量的判断结果，可帮助设计人员尽早做出调整；全面考察绕线资源，走线密度，走线延迟，走线距离等信息，从而获得较为全面的评估结果，有效减少误差。 | ||
| 搜索关键词： | 一种 集成电路 分层 线规 方法 装置 存储 介质 设备 | ||
【主权项】：
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