[发明专利]一种用于FPGA型时间数字转换器的延迟线校准电路在审
| 申请号： | 202011464080.8 | 申请日： | 2020-12-11 |
| 公开（公告）号： | CN112578661A | 公开（公告）日： | 2021-03-30 |
| 发明（设计）人： | 谢生;郭晓东;毛陆虹 | 申请（专利权）人： | 天津大学 |
| 主分类号： | G04F10/00 | 分类号： | G04F10/00 |
| 代理公司： | 天津市北洋有限责任专利代理事务所 12201 | 代理人： | 李林娟 |
| 地址： | 300072*** | 国省代码： | 天津;12 |
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| 摘要： | 本发明公开了一种用于FPGA型时间数字转换器的延迟线校准电路，所述延迟线校准电路由环形振荡器电路、控制电路、CAL_RAM与LUT_RAM存储单元组成；所述环形振荡器电路由复位信号控制起振，用于生成标定用的随机脉冲信号；所述控制电路通过有限状态机控制CAL_RAM和LUT_RAM的读写，完成延迟线的标定和计数值的累加；所述CAL_RAM和LUT_RAM电路通过调用Block RAM IP核实现，在标定状态下，CAL_RAM用于对延迟线中各延迟单元处出现跳变的次数进行存储；在累加状态下，LUT_RAM用于对跳变次数的累加值进行存储。本发明可移植性好、能够快速对延迟线进行在线校准的校准电路，降低温度/电压对延迟线延时的影响，提高了TDC的测量精度。 | ||
| 搜索关键词： | 一种 用于 fpga 时间 数字 转换器 延迟线 校准 电路 | ||
【主权项】：
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