[发明专利]针对每核心加速器分配的频率缩放在审
| 申请号： | 202011516266.3 | 申请日： | 2020-12-21 |
| 公开（公告）号： | CN113553167A | 公开（公告）日： | 2021-10-26 |
| 发明（设计）人： | S·T·巴勒莫;S·马基宁尼;S·博马林戈阿纳帕亚;N·查德瓦尼;R·T·埃尔赛义德;U·慕克吉;L·马苏尔;A·普兰德尔 | 申请（专利权）人： | 英特尔公司 |
| 主分类号： | G06F9/50 | 分类号： | G06F9/50 |
| 代理公司： | 永新专利商标代理有限公司 72002 | 代理人： | 刘瑜 |
| 地址： | 美国加*** | 国省代码： | 暂无信息 |
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| 摘要： | 用于针对每核心加速器分配的频率缩放的方法和关联装置。处理器包括具有多个核心的CPU(中央处理单元)，该多个核心可以被选择性地配置为支持频率缩放和指令扩展。在这种方法下，某些核心可以被配置为支持一组选择性AVX指令(例如，AVX3/5G‑ISA指令)和/或AMX指令，而其他核心被配置为不支持这些AVX/AMX指令。一方面，选择性AVX/AMX指令在与主处理器核心分开(或者以其他方式在处理器核心中包括单独的电路块)并且可以选择性地启用或禁用的一个或多个ISA扩展单元中实现。这使单独单元被禁用的核心能够消耗更少的功率和/或以更高的频率操作，同时支持使用其他核心的选择性AVX/AMX指令。这些能力增强性能并提供处理要求使用高级AVX/AMX指令来支持加速的工作负载的各种应用的灵活性。 | ||
| 搜索关键词： | 针对 核心 加速器 分配 频率 缩放 | ||
【主权项】：
暂无信息
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