[实用新型]一种时钟信号控制系统有效
| 申请号： | 202022829107.0 | 申请日： | 2020-11-27 |
| 公开（公告）号： | CN213690370U | 公开（公告）日： | 2021-07-13 |
| 发明（设计）人： | 周锦志 | 申请（专利权）人： | 卡莱特云科技股份有限公司 |
| 主分类号： | G06F1/04 | 分类号： | G06F1/04 |
| 代理公司： | 深圳国海智峰知识产权代理事务所(普通合伙) 44489 | 代理人： | 刘军锋 |
| 地址： | 518000 广东省深圳市南山区西丽街道西丽社*** | 国省代码： | 广东;44 |
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| 摘要： | 本实用新型涉及一种时钟信号控制系统，包括：FPGA芯片、无源信号产生模块、上拉电阻、产生有源时钟信号的有源信号产生模块和驱动该无源信号产生模块产生无源时钟信号的PHY芯片；该FPGA芯片通过PHY信号管脚与PHY芯片连接，通过第一参考时钟信号输入管脚分别并联该上拉电阻、无源信号产生模块和有源信号产生模块；该上拉电阻的一端与第一参考时钟信号输入管脚连接，另一端与电压输出端连接，以上拉该无源时钟信号的电平。能够通过上拉电阻上拉时钟信号的电平保证FPGA芯片识别到振幅较高的时钟信号，以及，将有源晶振作为在工作环境不稳定时启用的备用参考时钟来保证FPGA芯片始终能识别到稳定的参考时钟。 | ||
| 搜索关键词： | 一种 时钟 信号 控制系统 | ||
【主权项】：
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