[发明专利]存储器阵列外围中的位串累加有效
| 申请号： | 202080041743.7 | 申请日： | 2020-04-17 |
| 公开（公告）号： | CN113924622B | 公开（公告）日： | 2022-09-09 |
| 发明（设计）人： | V·S·拉梅什 | 申请（专利权）人： | 美光科技公司 |
| 主分类号： | G11C7/10 | 分类号： | G11C7/10;G11C7/12;G11C7/06 |
| 代理公司： | 北京律盟知识产权代理有限责任公司 11287 | 代理人： | 王龙 |
| 地址： | 美国爱*** | 国省代码： | 暂无信息 |
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| 摘要： | 描述存储器阵列外围中的位串累加。可利用控制电路系统(例如，处理装置)来控制存储器装置内使用位串的运算的进行。所述运算的结果可累加在所述存储器装置的存储器阵列外围的电路系统中。举例来说，多个读出放大器可耦合到存储器阵列和处理装置。所述多个读出放大器当中的读出放大器的数量可与所述阵列的行或列的数量相同。所述处理装置可配置成致使使用根据III型通用数格式或假定数格式格式化的一或多个位串的递归运算的进行。所述处理装置可进一步配置成致使表示所述递归运算的迭代的结果的所得位串累加在所述多个读出放大器中。 | ||
| 搜索关键词： | 存储器 阵列 外围 中的 累加 | ||
【主权项】：
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