[发明专利]一种基于OpenCL的高速并行化FPGA设计在审
| 申请号： | 202111358323.4 | 申请日： | 2021-11-16 |
| 公开（公告）号： | CN116136774A | 公开（公告）日： | 2023-05-19 |
| 发明（设计）人： | 沙金;于浩 | 申请（专利权）人： | 南京大学 |
| 主分类号： | G06F9/30 | 分类号： | G06F9/30;G06F9/38 |
| 代理公司： | 暂无信息 | 代理人： | 暂无信息 |
| 地址： | 210046*** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开了一种基于OpenCL的高速并行化FPGA设计架构，针对雷达信号处理领域数据量大、实时性要求高的特点，提出了一套完整的支持多种并行优化方式的CPU+FPGA异构加速方案。本方案对于常用的并行优化方式如流水线并行、多通道并行优化、循环迭代进行优化设计，并提供了全局内存、本地内存、内核间直传三种访存机制改善了并行化计算过程中数据传输效率的问题。本发明所提出的架构实现了相关的雷达算法包括二维FFT计算和特显点计算，与优化前的效率进行对比，给出分析结果，证明了提出的架构可以满足大部分并行处理的数据传输需求。 | ||
| 搜索关键词： | 一种 基于 opencl 高速 并行 fpga 设计 | ||
【主权项】：
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