[发明专利]一种基于FPGA的静态时序分析延迟计算加速系统及方法有效
| 申请号： | 202111399112.5 | 申请日： | 2021-11-24 |
| 公开（公告）号： | CN113822003B | 公开（公告）日： | 2022-03-11 |
| 发明（设计）人： | 罗召建;陈刚 | 申请（专利权）人： | 南京集成电路设计服务产业创新中心有限公司 |
| 主分类号： | G06F30/3315 | 分类号： | G06F30/3315 |
| 代理公司： | 北京德崇智捷知识产权代理有限公司 11467 | 代理人： | 王金双 |
| 地址： | 211800 江苏省南京市浦口区*** | 国省代码： | 江苏;32 |
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| 摘要： | 一种基于FPGA的静态时序分析延迟计算加速系统，包括，上位机和FPGA加速卡，其中，所述上位机，其通过文件读写，向所述FPGA加速卡发送延迟计算请求数据并从所述FPGA加速卡读取计算结果；所述FPGA加速卡，其接收上位机发送的延迟计算请求数据并进行计算，将计算结果发送给所述上位机；在系统内虚拟负责请求的文件和负责输出结果的文件，供所述上位机完成延迟计算请求数据的发送和计算结果的读取。本发明还提供了一种基于FPGA的静态时序分析延迟计算加速方法，大大提高了计算吞吐率，降低了资源消耗；降低了触发器和寄存器资源的消耗，有利于FPGA实现时的时序收敛。 | ||
| 搜索关键词： | 一种 基于 fpga 静态 时序 分析 延迟 计算 加速 系统 方法 | ||
【主权项】：
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