[发明专利]一种基于FPGA的PLC系统接收端等增益合并的实现方法在审
| 申请号： | 202210661388.4 | 申请日： | 2022-06-13 |
| 公开（公告）号： | CN115085765A | 公开（公告）日： | 2022-09-20 |
| 发明（设计）人： | 吕志恒;李知昊;林毅 | 申请（专利权）人： | 重庆邮电大学 |
| 主分类号： | H04B3/54 | 分类号： | H04B3/54;H04L1/00 |
| 代理公司： | 北京同恒源知识产权代理有限公司 11275 | 代理人： | 廖曦 |
| 地址： | 400065 *** | 国省代码： | 重庆;50 |
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| 摘要： | 本发明涉及一种基于FPGA的PLC系统接收端等增益合并的实现方法，属于物联网技术领域。当前数据为帧控数据，状态机控制当前状态为帧控操作状态，同时打开输入电路，合并电路将解交织后的输入数据进行累加，合并一次数据写入一次帧控输RAM；此外当前数据是载荷数据，状态机则控制当前状态为载荷操作状态，先打开输入电路将输入数据写入输入存储RAM，之后打开解交织电路和合并电路，待解交织和合并进行完后，将数据写入载荷输出RAM。上述的每一个状态结束后，状态机进入输出状态，从输出存储RAM中读出数据。本发明实现了通过状态机控制物联网通信接收端的的等增益分集合并数字电路，有效缩短分集合并时延，减少电路资源消耗。 | ||
| 搜索关键词： | 一种 基于 fpga plc 系统 接收 增益 合并 实现 方法 | ||
【主权项】：
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