[发明专利]一种数字延迟锁相环电路在审
| 申请号： | 202211070144.5 | 申请日： | 2022-09-02 |
| 公开（公告）号： | CN115938426A | 公开（公告）日： | 2023-04-07 |
| 发明（设计）人： | 徐映嵩;贾舒方;吴晨烨;宋晓亮;陈灿灿 | 申请（专利权）人： | 中国电子科技集团公司第五十八研究所 |
| 主分类号： | G11C11/4076 | 分类号： | G11C11/4076;G11C11/417;G11C7/22;H03L7/081;H03L7/18 |
| 代理公司： | 无锡派尔特知识产权代理事务所(普通合伙) 32340 | 代理人： | 杨立秋 |
| 地址： | 214000 *** | 国省代码： | 江苏;32 |
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| 摘要： | 本发明公开一种数字延迟锁相环电路，属于集成电路领域，包括波形调制模块、延迟链、波形调制及相位调整模块、相位比较器和移位控制器。波形调制模块对输入的CLK_IN时钟信号进行波形调制，便于后一级电路的运算；延迟链对于输入CLK_IN时钟信号进行延迟的作用；波形调制及相位调整模块将所述延迟链输出的波形进行调制，以及将CLK_DLL信号增加一个延迟时间△FB后得到CLK_FB信号；相位比较器将CLK_FB信号和输入的CLK_IN时钟信号进行比较，确认两者的相位差异，产生状态字FLAG1和FLAG2；移位控制器，受状态字FLAG1和FLAG2的控制，实现对所述延迟链的调节。 | ||
| 搜索关键词： | 一种 数字 延迟 锁相环 电路 | ||
【主权项】：
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