[发明专利]半导体器件的制造方法无效

专利信息
申请号: 97125250.5 申请日: 1997-12-24
公开(公告)号: CN1087498C 公开(公告)日: 2002-07-10
发明(设计)人: 铃木久满 申请(专利权)人: 日本电气株式会社
主分类号: H01L27/06 分类号: H01L27/06;H01L21/82
代理公司: 中国专利代理(香港)有限公司 代理人: 萧掬昌,傅康
地址: 日本*** 国省代码: 暂无信息
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摘要: 通过仅在发射极电极上原封不动地保持绝缘膜,同时对绝缘电极和栅电极构图,可以在形成PMOS的源-漏和非本征基极的过程中,防止在发射极电极中注入高浓度P型杂质,从而防止了发射极电阻的增加和分散。
搜索关键词: 半导体器件 制造 方法
【主权项】:
1.一种半导体器件的制造方法,包括:在半导体衬底表面上形成栅氧化膜和给发射极接触开孔;在栅氧化膜上形成导电膜和绝缘膜;在包括用于发射极接触区的区域上选择性地原封不动保持绝缘膜;形成用于栅电极的掩模;和同时形成栅电极和发射极电极。
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